DC Field | Value | Language |
---|---|---|
dc.contributor.advisor | 조병진 | - |
dc.contributor.advisor | Cho, Byung-Jin | - |
dc.contributor.author | 박종경 | - |
dc.contributor.author | Park, Jong-Kyung | - |
dc.date.accessioned | 2011-12-14T01:35:11Z | - |
dc.date.available | 2011-12-14T01:35:11Z | - |
dc.date.issued | 2010 | - |
dc.identifier.uri | http://library.kaist.ac.kr/search/detail/view.do?bibCtrlNo=419222&flag=dissertation | - |
dc.identifier.uri | http://hdl.handle.net/10203/36619 | - |
dc.description | 학위논문(석사) - 한국과학기술원 : 전기 및 전자공학과, 2010.2, [ xi, 67 p. ] | - |
dc.description.abstract | 최근, 비휘발성 메모리 어플리케이션에서 하이케이 유전체와 금속 게이트에 대한 연구와 개발이 활발히 진행되고 있다[1]. 상용화된 낸드플래쉬메모리 중에서 특히나 charge-trapping type device가 near-planar structure 로 인한 디바이스 스케일링에 대한 이점과 이산저장방식으로 인한 인접 게이트 간 간섭에 강하다는 장점으로 인하여 40nm 급 이하의 NAND Flash memory 에서 유망한 대안으로 관심이 증가되고 있다[1~2]. 다양한 charge-trapping type device 중에서 $TANOS(TiN-Al_2O_3-Si_3N_4-SiO_2-Si)$ 구조는 높은 일함수를 갖는 금속 전극과 물리적으로 두꺼운 Al2O3 하이케이 유전체의 장점을 적용하여 빠른 동작 속도와 우수한 data retention 특성을 동시에 보여주었다[2]. 그러나 지속적인 소자의 scaling 과 더불어 멀티레벨셀 구현을 위해서는 동작속도와 data retention 특성이 더욱 개선되어야 하며, 따라서 기존의 $Al_2O_3$ 비하여 conduction band offset 의 큰 감소 없이 보다 큰 유전상수(12~30)를 갖는 유전체가 요구된다. 본 논문에서는 30~40 정도의 유전상수를 갖는 큐빅 구조의 HfLaO 박막을 charge trapping type 플래쉬 메모리 소자의 blocking layer로 사용하였다. 기존의 $Al_2O_3$ 박막에 비하여 단일 HfLaO 박막의 경우 낮은 누설전류 특성으로 인한 빠른 프로그램 속도와 큰 메모리 윈도우와 동시에 높은 동작전압에 대한 강인함을 보여주었지만 낮은 conduction band offset으로 인한 데이터 retention 특성의 악화가 문제점이 된다. 그러나 HfLaO 과 $Si_3N_4$ 전하 저장층 사이에 $Al_2O_3$ barrier layer를 삽입하여 HfLaO 의 높은 유전상수 값과 $Al_2O_3$ 의 높은 conduction band offset의 장점을 동시에 적용하는 방법으로 단일 HfLaO 가 갖는 장점을 유지하는 동시에 단일 $Al_2O_3$ 박막에 준하는150도 retention 특성을 확보하였다. 다음으로 charge trapping type 플래쉬 메모리에서 $Al_2O_3$ 를 blocking layer로 사용한 경우 Post-deposition annealing(PDA) 온도에 따른 메모리 특성에 대한 연구를 진행하였다. 플로팅게이트타입플래쉬 메모리에서의 inter-poly 의 경우에는 $Al_2O_3$ PDA 온도에 따른 메모리 특성의 연구가 많이 진행되었으나 charge-trapping type의 경우에는 발표된 연구 결과가 거의 없다. 실험 결과 1100도 이상의 고온 PDA 공정 후에 program/erase 속도 향상과 더불어 메모리 윈도우 또한 커지고 150도 고온 retention 특성이 동시에 향상되는 것을 확인하였다. 이에 따른 메커니즘으로는 고온 공정 후 $Si_3N_4$ charge trapping layer 내의 deep trap energy level에 추가적인 trap density의 증가와 더불어 $Al_2O_3$ blocking layer를 통한 trap-assiatant tunneling current를 줄이는 trapping efficiency의 감소 때문인 것으로 추정된다. | kor |
dc.language | kor | - |
dc.publisher | 한국과학기술원 | - |
dc.subject | 하이케이 유전체 | - |
dc.subject | 지우기 | - |
dc.subject | 보유력 | - |
dc.subject | 이산 전하 저장형 플래쉬 메모리 | - |
dc.subject | 블럭킹 레이어 | - |
dc.subject | blocking layer | - |
dc.subject | high-k dielectric | - |
dc.subject | erase | - |
dc.subject | retention | - |
dc.subject | charge-trapping type flash memory | - |
dc.title | High- κ 유전체를 사용한 Charge-trapping type플래쉬 메모리 소자에서 데이터 Retention 특성과 Erase 속도 개선 | - |
dc.title.alternative | Improvement of data retention and erase speed in charge-trapping type flash memory devices using high-κ dielectric | - |
dc.type | Thesis(Master) | - |
dc.identifier.CNRN | 419222/325007 | - |
dc.description.department | 한국과학기술원 : 전기 및 전자공학과, | - |
dc.identifier.uid | 020083199 | - |
dc.contributor.localauthor | 조병진 | - |
dc.contributor.localauthor | Cho, Byung-Jin | - |
Items in DSpace are protected by copyright, with all rights reserved, unless otherwise indicated.