DC Field | Value | Language |
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dc.contributor.author | 이귀로 | ko |
dc.contributor.author | 곽재영 | ko |
dc.contributor.author | 윤상식 | ko |
dc.date.accessioned | 2022-11-22T02:01:30Z | - |
dc.date.available | 2022-11-22T02:01:30Z | - |
dc.identifier.uri | http://hdl.handle.net/10203/300420 | - |
dc.description.abstract | 본 발명은 새로운 형태의 필드 프로그래머블 게이트 어레이(FPGA : Field Programmable Gate Array)에 관한 것으로, 보다 상세하게는 실제 동작중에 빠른 시간안에 재구성 할 수 있는 형태의 특정 목적의 로직 부분인 실시간 재구성 가능한 데이터 패스 로직(RTBR DPL : Run Time Block Reconfigrable Data Path Logic)을 첨가한 필드 프로그래머블 게이트 어레이에 관한 것으로서, 4 비트를 기본 단위로 가산, 감산, 승산의 기능을 가지는 이 RTBR DPL의 도입은 기존의 로직 구현에 사용되어지는 컨피규러블 로직 블록의 속도와 용량면에서의 단점을 극복할 수 있는 잇점이 있다. | - |
dc.title | 실시간 재구성 가능한 데이터 패스 로직을 가지는 필드 프로그래머블 게이트어레이 | - |
dc.title.alternative | Field Programmable Gate Array with Run Time BlockReconfigurable Data Path Logic | - |
dc.type | Patent | - |
dc.type.rims | PAT | - |
dc.contributor.localauthor | 이귀로 | - |
dc.contributor.nonIdAuthor | 곽재영 | - |
dc.contributor.nonIdAuthor | 윤상식 | - |
dc.contributor.assignee | 한국과학기술원 | - |
dc.identifier.iprsType | 특허 | - |
dc.identifier.patentApplicationNumber | 10-1999-0023098 | - |
dc.identifier.patentRegistrationNumber | 10-0321314-0000 | - |
dc.date.application | 1999-06-19 | - |
dc.date.registration | 2002-01-07 | - |
dc.publisher.country | KO | - |
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