루프지연을 개선한 디지털 위상고정루프DIGITAL PHASE LOCKED LOOP WITH IMPROVED LOOP DELAY FEATURE

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본 발명은 디지털 위상고정루프에 관한 것으로, 기준 클럭의 위상을 누적하고, 누적된 값을 샘플링하여 기준 샘플링 위상값을 출력하는 기준 위상 누적부; 상기 기준 위상 누적부로부터의 기준 샘플링 위상값과 DCO 샘플링 위상값과의 차이값에 해당되는 위상차 신호를 검출하는 위상 검출부; 상기 위상 검출부로부터의 위상차 신호를 필터링하여 평균화하는 디지털 루프 필터; 상기 디지털 루프 필터에 의해 평균화된 위상차 신호에 기초해서 기설정된 주파수를 갖는 발진 신호를 생성하는 디지털 제어 발진기; 상기 디지털 제어 발진기로부터의 발진신호의 위상을 누적하고, 누적된 값을 샘플링하여 DCO 샘플링 위상값을 출력하고, 기준 클럭의 주파수보다 보다 높고 서로 동일한 주파수를 갖고 서로 순차적으로 위상이 지연된 복수의 제1 내지 제n 클럭 신호를 생성하는 DCO 위상 누적부; 상기 위상 검출부, 디지털 루프 필터, 디지털 제어 발진기와 DCO 위상 누적부를 포함하는 폐루프중 기설정된 위치에 각각 포함되고, 상기 DCO 위상 누적부로부터의 복수의 제1 내지 제n 클럭 신호 각각에 따라 동작하는 복수의 제1 내지 제n D-FF를 포함한다. PLL, 위상고정루프, 루프지연, DCO, 디지털 제어 발진기
Assignee
삼성전기주식회사,한국과학기술원
Country
KO (South Korea)
Issue Date
2011-12-26
Application Date
2009-12-04
Application Number
10-2009-0119924
Registration Date
2011-12-26
Registration Number
10-1101447-0000
URI
http://hdl.handle.net/10203/233311
Appears in Collection
EE-Patent(특허)
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