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1
$.8 \um m$ CMOS를 이용한 1.485 Gb/s 병렬화기의 설계 = 1.485 Gb/s deserializer chip design using $.8 \um m$ CMOS for HDTV applicationlink

류지열; Ryoo, Ji-Yeoul; et al, 한국과학기술원, 1999

2
(An) implementation of the variable length encoder/decoder in real-time encoding/decoding system (REDS) for HDTV = HDTV 실시간 압축/복원 시스템에서 가변길이 부호화/복호화의 구현link

Park, Joon-Hong; 박준홍; et al, 한국과학기술원, 1999

3
Interfacing controllers in real-time encoding/decoding system for HDTV editor = HDTV 편집기용 영상 압축 및 복원 시스템에서 데이터 교환 제어기link

Kang, Jeon; 강전; et al, 한국과학기술원, 1999

4
Processor and memory interface architecture for HDTV decoding = HDTV 복호를 위한 프로세서와 메모리 인터페이스 구조link

Kim, Han-Soo; 김한수; et al, 한국과학기술원, 2001

5
A real-time encoding and decoding system for nonlinear HDTV editor

Lee, Chul Soo; Park, JoonHong; Yoon, DooSoo; Jeon, JaeHo; Park, HyunWook; Yeo, Ji Hee; Lee, Jong Hwa, International Journal of Imaging Systems and Technology Volume 11, Issue 2 , Pages 152 - 157, 2000-07

6
상위수준 합성을 이용한 HDTV용 PCR클럭 복원을 위한 디지털 위상제어루프의 설계 = The design of PCR clock recovery digital PLL for HDTV using high-level synthesislink

김진욱; Kim, Jin-Wook; et al, 한국과학기술원, 1998

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