Background Calibration을 이용한 12-bit 500MS/s Binary-Weighted 전류 구동 DAC = A 12-bit 500MS/s binary-weighted current steering DAC with background calibration

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본 논문에서는 기존의 background calibration 기법에서 나타나는 calibration spur을 제거하기 위해서 return-to-zero 신호를 이용하였다. 또한 return-to-zero 신호는 이전 입력 data에 무관한 출력 파형 transition을 가지기 때문에 동적 선형성을 개선하였다. 고속 동작 DAC의 동적 선형성을 향상시키기 위해 single-in-line stacked unit cell(SUC) 배열하여 layout을 하여 parasitic 성분을 최소화였다. 고해상도 DAC을 설계함에 있어서 calibration하기 때문에 전류원의 크기를 줄일 수 있었으며 2-stage 전류원 구조를 이용해 설계를 하여 DAC의 면적을 최소화할 수 있었다. 또한 전류의 error 값을 calibration을 하기 때문에 특별한 스위칭 기법을 사용하지 않아 라우팅을 짧고 간단하게 설계를 하였다. 측정 결과 500MS/s에서 Nyquist 입력 신호에서 73.7dB의 결과를 얻을 수 있었다.
Advisors
류승탁researcherRyu, Seung-Tak
Description
한국과학기술원 : 전기및전자공학과,
Publisher
한국과학기술원
Issue Date
2014
Identifier
569295/325007  / 020123726
Language
kor
Description

학위논문(석사) - 한국과학기술원 : 전기및전자공학과, 2014.2, [ vi, 34 p. ]

Keywords

디지털 아날로그 변환기; RZ; return to zero; background calibration; SUC; DAC; 싱글인라인; 백그라운드 캘리브레이션; 리턴투제로

URI
http://hdl.handle.net/10203/196619
Link
http://library.kaist.ac.kr/search/detail/view.do?bibCtrlNo=569295&flag=dissertation
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EE-Theses_Master(석사논문)
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